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matlab

filter

具体用法见帮助搜索fvtool

eg:

b=[b0,b1,b2];
a=[a0,a1,a2];

fvtool(b,a);

其中a,b数组内为滤波器系数。
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it

‍Unsupported ModelSim library format for 'work'

这是由于重装的modelsim当前工作目录work与打开的项目工作目录work路径不相符。运行下列命令可修正:

vdel -all
vlib work
vmap work work
vcom

(2013-06-09 17:40)
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verilog

it

4.6.5 条件运算符
条件操作符根据条件表达式的值选择表达式,形式如下:
cond_expr ? expr1 : expr2

如果cond_expr 为真(即值为1 ),选择expr1 ;如果cond_expr 为假(值为0 ),选择expr2 。如果
cond_expr 为x 或z ,结果将是按以下逻辑expr1 和expr2 按位操作的值: 0 与0 得0 ,1 与1 得1 ,其
余情况为x 。

如下所示:
wire [2:0] Student = Marks > 18 ? Grade_A : Grade_C;
计算表达式Marks > 18; 如果真, Grade_A 赋值为Student; 如果Marks < =18, Grade_C 赋值为Student 。

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it

verilog

1、{ }表示拼接,{第一位,第二位...};
2、{{ }}表示复制,{4{a}}等同于{a,a,a,a};
所以{13{1‘b1}}就表示将13个1拼接起来,即13'b1111111111111。
  

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